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上課地點：【上海】：同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院【北京分部】：北京中山學院/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領(lǐng)館區(qū)1號（中和大道）【沈陽分部】：沈陽理工大學/六宅臻品【鄭州分部】：鄭州大學/錦華大廈【石家莊分部】：河北科技大學/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：協(xié)同大廈
最近開課時間(周末班/連續(xù)班/晚班）： Synopsys培訓班：2020年3月16日

實驗設(shè)備

　    ☆資深工程師授課


        ☆注重質(zhì)量
        ☆邊講邊練
        ☆合格學員免費推薦工作

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        專注高端培訓15年，端海提供的證書得到本行業(yè)的廣泛認可，學員的能力
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質(zhì)量保障

        1、培訓過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結(jié)束后,授課老師留給學員聯(lián)系方式,保障培訓效果,免費提供課后技術(shù)支持。
        3、培訓合格學員可享受免費推薦就業(yè)機會。

　　　　　　　　Synopsys物理綜合設(shè)計方法學和設(shè)計工具培訓班

隨著國內(nèi)集成電路設(shè)計產(chǎn)業(yè)的發(fā)展，越來越多的本地設(shè)計公司開始采用目前國際上主流（Mainstream）的物理綜合的設(shè)計方法。隨著半導體工藝的發(fā)展和設(shè)計復雜度的提升，設(shè)計方法也不得不隨之改變。在面對0.18微米及以下工藝，100MHz以上主頻的設(shè)計時，若仍采用傳統(tǒng)的綜合和布局布線分別考慮，利用線負載模型（Wire-load Model）估計連線延遲的設(shè)計方法，前后端的迭代次數(shù)明顯增加，甚至引起設(shè)計的不收斂，造成設(shè)計周期的延誤，或設(shè)計性能的下降。Synopsys自2000年起推出Physical Compiler，并結(jié)合其他一系列工具，從設(shè)計方法學著手解決時序收斂的問題。目前，Physical Compiler是全球基于0.18微米工藝，100MHz以上頻率的主流設(shè)計所采用的主要設(shè)計工具。

??為了讓更多的本地設(shè)計工程師熟悉物理綜合工具及其設(shè)計方法學，特開設(shè)本課程。
課程內(nèi)容如下：
課程內(nèi)容如下：

　　　一、基于物理綜合的芯片實現(xiàn)方案介紹（上）
　　　二、基于物理綜合的芯片實現(xiàn)方案介紹（下）
　　　三、新版物理綜合工具Physical Compiler介紹與使用技巧
　　　四、基于Physical Compiler的設(shè)計流程演示

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